Saturday, February 4th 2012, 1:57pm UTC+1
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.Korrigiert!
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Der Phenom II 960T ist doch auch angekündigt aber net blau markiert in der Liste
Doch, der eine ist ja blau und laut unseren News kommt das 95W Modell in den Handel.
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und es gibt nur einen Phenom II 955 C3 und nicht zwei!
Werd' ich tun!
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Man sollte auch dazu schreiben das einige CPU's auf AM2+ Abwärtskompatibel, sind sofern der Hersteller des Boardes das freigibt (AM3ready ect.) !
Das C3 Stepping ist dort angekündigt worden. Wollte keine Unterteilung in angekündigtes C3 und fertiges C3 Stepping.
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der phenom II X2 555 ist im C3 stepping hergestellt![]()
Ist damit gemeint. Werde es korrigieren.
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Ist der FSB takt, den ihr angegeben habt, nicht der Hypertransport takt?
This post has been edited 1 times, last edit by "Kreisverkehr" (Apr 18th 2010, 2:33pm)
Die Tabelle soll nur eine Übersicht der CPUs mit Taktungen und Namen beinhalten, damit man weiß, in welcher Rubrik man sich befindet. Dein Part gehört zum Wissen, was nicht unbedingt notwendig ist. Dann müsste man es bei jeder Familie so machen. Kannst mir ja eine Vorlage erstellen, die ich per Copy&Paste einfüge
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Vllt sollte noch irgendwo erwähnt werden, dass der kommende Sechskerner nicht im gleichen Herstellungsverfahren hergestellt wird, wie der Deneb (in den jeweiligen Steppings), sondern sich statt Siliziumdioxid nun ein low-k-Isolator zwischen den Kupferleitungen befindet.
=> Weniger Spannung notwending und vermutlich eine bessere Übertaktbarkeit, da weniger Spannung (Kondensatoreffekt) benötigt wird, um die Elektronen durch die Schaltungen zu "jagen".
.Dann würde ich eine 4. Spalte mit dem passenden Die aufmachen. Aber die ist ja in der Regel bei allen Familien immer gleich - weiß' nicht, ob es dann der Übersicht gut tut, wenn beispielsweise hinter jedem Phenom II X3 dann Deneb steht?!
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e:/ Was mir glatt beim Abschicken einfiel: Ich persönlich weiß, welcher Die wo verwendet wird, also dass der Zosma eigentlich ein (freischaltbarer) Sechskerner ist, so wie der Phenom II X3 sich zum eigentlichen Deneb-Kern verhält.
Wäre vllt schön, das noch zu kennzeichen, ob ein Freischalten überhaupt versucht werden kann (Dass einige Phenom II-Kerne zu Athlon II-Kernen zwecks Nachfrage gemacht wurden/werden, ist mir persönlich egal, da es nicht die Regel ist, sondern eigentlich eine L3-Freie Maske verwendet wird).
Ansichtssache
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Nochwas: Hab erstmal bisl blöd gschaut, wegen den L1/L2-Cachegröße, aber du hast sie ja zusammengerechnet und nicht pro Kern angegeben. Finde ich - fr mich - eher verwirrend, so ist nur der L3-Cache gemeinsach, die schnelleren/kleineren aber nur für jeden Kern einzeln nutzbar und für die anderen Kerne nur über den L3 erreichbar.
. 

Und in den News schreiben wir beim Phenom II X6 nur noch 9MB Cache.
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naja L2 und L3 sind schon zwei verschieden Paarschuh
Der L2 ist schneller und ist nur EINEM Kern vorbehalten
der L3 ist langsamer und Allen Kernen vorbehalten und ist soerat angebracht.
Wäre die logische Schlussfolgerung
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Ich würde einfach "4x XXMB L2 + XXMB L3" schreiben![]()
.Find' ich wie beim Die überflüssig, da jede Serie je nach Kernen gleich viel Cache hat. Ansonsten schreib' ich es dabei.
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also eine neue Spalte, die dann Cache heißt.
Dann soll da ein "-" stehen?
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naja und es passt auch nicht wenn i nder Multiu Spalte der cache steht o.ä.![]()